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17 Results
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Intercepting functions for memoization

Arjun Suresh
Programming Languages [cs.PL]. Université Rennes 1, 2016. English. ⟨NNT : 2016REN1S106⟩
Theses tel-01410539v2
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Améliorer la performance séquentielle à l’ère des processeurs massivement multicœurs

Nathanaël Prémillieu
Autre [cs.OH]. Université Rennes 1, 2013. Français. ⟨NNT : 2013REN1S071⟩
Theses tel-00916589v1
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Blocs nuls dans la hiérarchie mémoire

Julien Dusser
Réseaux et télécommunications [cs.NI]. Université Rennes 1, 2010. Français. ⟨NNT : ⟩
Theses tel-00557080v1
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Certified Compilation and Worst-Case Execution Time Estimation

André Oliveira Maroneze
Cryptography and Security [cs.CR]. Université Rennes 1, 2014. English. ⟨NNT : 2014REN1S030⟩
Theses tel-01064869v2
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Behavioral Application-dependent superscolor core modeling

Ricardo Andrés Velásquez Vélez
Other [cs.OH]. Université Rennes 1, 2013. English. ⟨NNT : 2013REN1S100⟩
Theses tel-00942289v1
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Infrastructures and Compilation Strategies for the Performance of Computing Systems

Erven Rohou
Other [cs.OH]. Université de Rennes 1, 2015
Habilitation à diriger des recherches tel-01237164v1
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Throughput Oriented Analytical Models for Performance Estimation on Programmable Accelerators

Junjie Lai
Hardware Architecture [cs.AR]. Université de Rennes I, 2013. English. ⟨NNT : ⟩
Theses tel-00908579v1
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Exploiting heterogeneous manycores on sequential code

Bharath Narasimha Swamy
Computer Science [cs]. UNIVERSITE DE RENNES 1, 2015. English. ⟨NNT : ⟩
Theses tel-01126807v1
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De la nécessité d'une vision holistique du code pour l'analyse statique et la correction automatique des Applications Web

Christophe Levointurier
Web. Université Rennes 1, 2011. Français. ⟨NNT : 2011REN1S156⟩
Theses tel-00688117v1
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Extraction and traceability of annotations for WCET estimation

Hanbing Li
Other [cs.OH]. Université Rennes 1, 2015. English. ⟨NNT : 2015REN1S040⟩
Theses tel-01232613v1
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Modeling performance of serial and parallel sections of multi-threaded programs in manycore era

Surya Narayanan Natarajan
Hardware Architecture [cs.AR]. INRIA Rennes - Bretagne Atlantique and University of Rennes 1, France, 2015. English. ⟨NNT : ⟩
Theses tel-01170039v1
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Architecture multi-coeurs et temps d'exécution au pire cas

Benjamin Lesage
Autre [cs.OH]. Université Rennes 1, 2013. Français. ⟨NNT : 2013REN1S034⟩
Theses tel-00870971v1
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Transforming TLP into DLP with the dynamic inter-thread vectorization architecture

Sajith Kalathingal
Hardware Architecture [cs.AR]. Université Rennes 1, 2016. English. ⟨NNT : 2016REN1S133⟩
Theses tel-01426915v3
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Analyse pire cas pour processeur multi-cœurs disposant de caches partagés

Damien Hardy
Réseaux et télécommunications [cs.NI]. Université Rennes 1, 2010. Français. ⟨NNT : ⟩
Theses tel-00557058v1
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Vers un partitionnement automatique d'applications en codelets spéculatifs pour les systèmes hétérogènes à mémoires distribuées

Eric Petit
Réseaux et télécommunications [cs.NI]. Université Rennes 1, 2009. Français. ⟨NNT : ⟩
Theses tel-00445512v1
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Behavioral Application-dependent Superscalar Core Modeling

Ricardo Andrés Velásquez Vélez
Hardware Architecture [cs.AR]. Université Rennes 1, 2013. English. ⟨NNT : ⟩
Theses tel-00908544v1
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Adaptive and Intelligent Memory Systems

Aswinkumar Sridharan
Hardware Architecture [cs.AR]. INRIA Rennes - Bretagne Atlantique and University of Rennes 1, France, 2016. English. ⟨NNT : ⟩
Theses tel-01442465v1