Développement de circuits logiques programmables résistants aux aléas logiques en technologie CMOS submicrométrique - TEL - Thèses en ligne Accéder directement au contenu
Thèse Année : 2007

Development of Single-Event Upset hardened programmable logic devices in deep submicron CMOS

Développement de circuits logiques programmables résistants aux aléas logiques en technologie CMOS submicrométrique

S. Bonacini
  • Fonction : Auteur
  • PersonId : 844861

Résumé

The electronics associated to the particle detectors of the Large Hadron Collider (LHC), under construction at CERN, will operate in a very harsh radiation environment. Most of the microelectronics components developed for the first generation of LHC experiments have been designed with very precise experiment-specific goals and are hardly adaptable to other applications. Commercial On-The-Shelf (COTS) components cannot be used in the vicinity of particle collision due to their poor radiation tolerance. This thesis is a contribution to the effort to cover the need for radiation-tolerant SEU-robust programmable components for application in High Energy Physics (HEP) experiments. Two components are under development: a Programmable Logic Device (PLD) and a Field-Programmable Gate Array (FPGA). The PLD is a fuse-based, 10-input, 8-I/O general architecture device in 0.25 μm CMOS technology. The FPGA under development is instead a 32 × 32 logic block array, equivalent to ~25k gates, in 0.13 μm CMOS. This work focussed also on the research for an SEU-robust register in both the mentioned technologies. The SEU-robust register is employed as a user data flip-flop in the FPGA and PLD designs and as a configuration cell as well in the FPGA design.
L'électronique associée aux détecteurs de particules du grand collisionneur d'hadrons (LHC), en construction au CERN, fonctionnera dans un environnement très radioactif. La plupart des composants microélectroniques développés pour la première génération des expériences du LHC ont été conçues avec des buts spécifiques et très précis, non adaptables pour d'autres applications. Les composants commerciaux ne peuvent pas être employés en proximité du point de collision des particules, car ils ne sont pas tolérants aux radiations. Cette thèse contribue à couvrir le besoin en composants programmables résistants aux rayonnements et aux alea logiques pour les expériences de physique des hautes énergies. Dans ce sens, deux composants sont en cours de développement : un dispositif logique programmable (PLD) et un réseau de portes programmables in-situ (FPGA). Ce travail s'est concentré également sur la recherche d'un registre résistant aux alea logiques dans les deux technologies mentionnées. Le registre est utilisé comme bascule pour les données d'utilisateur dans le FPGA et le PLD, mais aussi comme cellule de configuration dans le FPGA.
Fichier principal
Vignette du fichier
dcl_0271.pdf (8.89 Mo) Télécharger le fichier
Loading...

Dates et versions

tel-00192815 , version 1 (29-11-2007)

Identifiants

  • HAL Id : tel-00192815 , version 1

Citer

S. Bonacini. Développement de circuits logiques programmables résistants aux aléas logiques en technologie CMOS submicrométrique. Micro et nanotechnologies/Microélectronique. Institut National Polytechnique de Grenoble - INPG, 2007. Français. ⟨NNT : ⟩. ⟨tel-00192815⟩

Collections

UGA
209 Consultations
566 Téléchargements

Partager

Gmail Facebook X LinkedIn More